1、什么是建立時間和保持時間? 建立時間:指在觸發器的時鍾信號上升沿到來以前,數據穩定不變的時間。如果建立的時間不滿足要求那么數據將不能在這個時鍾上升沿被穩定的打入觸發器 保持時間:是指在觸發器的 ...
如圖所示時序路徑示意圖,橢圓表示組合邏輯,FF ,FF 表示寄存器,A表示數據輸入端口,CLK表示時鍾輸入端口,Z表示數據輸出端口 C A.只要在端口CLK上創建時鍾,即可約束A gt Z之間的組合邏輯的延時。 B. 只要在端口Z上設置輸出延時,即可約束FF gt Z之間的組合邏輯的延時。 C. 只要在端口CLK上創建時鍾,即可約束FF gt FF 之間的組合邏輯的延時 D. 只要在端口A上設置 ...
2020-09-10 10:42 2 1583 推薦指數:
1、什么是建立時間和保持時間? 建立時間:指在觸發器的時鍾信號上升沿到來以前,數據穩定不變的時間。如果建立的時間不滿足要求那么數據將不能在這個時鍾上升沿被穩定的打入觸發器 保持時間:是指在觸發器的 ...
1、CMOS/TTL/ECL電路的比較 補充:CMOS和TTL電路的區別是什么? 結構:CMOS電路由場效應管,TTL由雙極性晶體管構成。 電平范圍:CMOS邏輯電平范圍大(5~15 ...
1、什么是時鍾抖動(jitter) 芯片的某一個給定點上時鍾周期發生暫時性變化,即達到電路某一點的連續時鍾邊沿之間間隔的變化稱為時鍾抖動。 2、什么是時鍾偏移(skew) 時鍾信號到達 ...
1、典型FPGA的開發流程 2、FPGA內部資源包括哪些及作用? 1)、輸入輸出單元(IOB) 可編程輸入/輸出單元簡稱 I/O 單元,是芯片與外界電路的接口部分,完成不同電氣特性下對 ...
1、速度和面積互換原則 所謂速度,是指整個工程穩定運行所能達到的最高時鍾頻率,他不僅和FPGA內部各個寄存器的建立時間、保持時間以及FPGA與外部接口的各種時序要求有關,而且還和兩個緊鄰的寄存器間的邏輯延時、走線延時有關。 所謂面積,可通過一個工程運行所消耗的觸發器、查找表數量或者等效門數量 ...
1、讀寫沒有空閑周期。(fA>fB) fA = 80MHz fB = 50MHz Burst Length = 120 讀寫之間沒有空閑周期,是連續讀寫一個突發長度。 解法: ...
低功耗簡單知識 1、低功耗分類? 分為靜態功耗和動態功耗; 靜態功耗是指漏電流功耗,是電路狀態穩定時的功耗,其數量級很小; 動態功耗是指電容充放電功耗和短路功耗,是由電路的翻轉造成的; ...
1、 最能描述集成電路工藝技術水平的技術指標是(B) A、晶片直徑 B、特征尺寸 C、芯片面積 D、封裝 2、 相同工藝條件下,下列哪種邏輯的組合邏輯延遲最長(A) A、2輸入異或門 B、 ...