ASIC DC綜合的理解
ASIC DC綜合的理解 DC綜合流程 輸入設計文件+指定的工藝庫文件+約束文件 經過DC的綜合，輸出滿足期望的門級網表及綜合報告 輸入輸出數據 輸入文件：設計文件（verilog等）、工藝庫（db）、約束文件 輸出文件：網表（Netlist ...
原文：數字asic流程實驗（四） DC綜合
數字asic流程實驗 四 DC綜合 .Design Compiler 簡介 Design Compiler 以下簡稱DC 是Synopsys公司用於做電路綜合的核心工具，可以將HDL描述的電路轉換為基於工藝的門級網表。 邏輯綜合分為三個階段： 轉譯 Translation ：把電路轉換為EDA內部數據庫，這個數據庫跟工藝是獨立無關的 優化 Optimozation ：根據工作頻率 面積 功耗來對電 ...
2021-07-26 22:51 0 169 推薦指數：
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本文如果有錯，歡迎留言更正；此外，轉載請標明出處 http://www.cnblogs.com/IClearner/ ，作者：IC_learner 1、基本流程概述 首先給三個圖，一個圖是高層次設計的流程圖： 下面是我對這張圖的理解： ① 設計之前，准備好庫、HDL代碼 ...