主要參考了https://www.eefocus.com/liu1teng/blog/12-02/237897_4533d.html 、Xilinx UG471、UG472以及Xilinx Forum ...
轉自:http: www.eefocus.com liu teng blog d.html 前一段時間畫了一塊千兆擴展板,板子上有千兆網口和千兆光纖接口,兩種介質可以通過跳線來轉換,板子做好之后進行回環測試時,發現網口會有隨機的丟幀現象,而光口是正常的,一直沒有找到問題根源,后來在做另一個項目里,需要寫MAC的時序約束,發現Xilinx提供的MAC硬對 RX CLK 的時序約束要求很高,建立時間只 ...
2017-08-09 17:26 1 8277 推薦指數:
主要參考了https://www.eefocus.com/liu1teng/blog/12-02/237897_4533d.html 、Xilinx UG471、UG472以及Xilinx Forum ...
原創 by DeeZeng [ Intel FPGA筆記 ] FPGA 的 CLK pin 是否可以用作普通輸入 ,輸出或雙向IO 使用? 這些專用Clock input pin 是否可以當作 inout用,需要看FPGA是否支持。 像cyclone V ...
FPGA中的時鍾域問題 一、時鍾域的定義 所謂時鍾域,就是同一個時鍾驅動的區域。這里的驅動,是指時鍾刷新D觸發器的事件,體現在verilog中就是always的邊沿觸發信號。單一時鍾域是FPGA的基本組成部分,但是隨着設計規模擴大,多時鍾域的設計是必要的。維持龐大的單時鍾域對時鍾源的要求 ...
skew通常是時鍾相位上的不確定,而jitter是指時鍾頻率上的不確定。造成skew和jitter的原因很多。 由於時鍾源到達不同寄存器所經歷路徑的驅動和負載的不同,時鍾邊沿的位置有所差異,因此就帶來了skew。 而由於晶振本身穩定性,電源以及溫度變化等原因造成了時鍾頻率的變化 ...
之前調試一塊FPGA板卡,上電后總是無法正常工作。 現象:nSTATUS指示燈不停的閃爍,測試用的LED(FPGA的GPIO)無法點亮,即FPGA沒有進入正常工作狀態。 調試過程: 1、FPGA在上電后,會立刻將nSTATUS配置狀態管腳置成低電平,並在上電復位(POR)完成之后釋放 ...
Edit → language templates : 打開即可查看基本語法。 一、xilinx中的約束文件 1、約束的分類 利用FPGA進行系統設計常用的約束主要分為3類。 (1)時序約束:主要用於規范設計的時序行為,表達設計者期望滿足的時序條件,知道綜合和布局布線階段的優化 ...
原理介紹 1、分頻 FPGA設計中時鍾分頻是重要的基礎知識,對於分頻通常是利用計數器來實現想要的時鍾頻率,由此可知分頻后的頻率周期更大。一般而言實現偶數系數的分頻在程序設計上較為容易,而奇數分頻則相對復雜一些,小數分頻則更難一些。 1)偶分頻系數=時鍾輸入頻率/時鍾輸出頻率=50MHz ...
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