Verilog HDL基本語句
1.過程語句 Verilog中有兩種結構化過程語句：initial和always語句，是行為建模的兩種基本語句，所有的行為語句只能出現在這兩種結構化過程語句里。 每個initial語句和always語句代表一個獨立的執行過程（或過程塊）。 一個模塊可以包含多條always語句和多條 ...
原文：Verilog HDL模型的不同抽象級別
所謂不同的抽象類別，實際上是指同一個物理電路，可以在不同層次上用Verilog語言來描述。如果只從行為功能的角度來描述某一電路模塊，就稱作行為模塊。如果從電路結構的角度來描述該電路模塊，就稱作結構模塊。根據抽象的級別將Verilog的模塊分為 種不同的等級: 系統級 算法級 RTL級 register transfer level 門級 開關級。 對於數字系統的邏輯設計工程師而言：熟練地掌握門級 ...
2016-09-28 16:31 0 2860 推薦指數：
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