1.下面关于PLL电路表述正确的是: A. PLL属于模拟电路,无法用全数字电路实现 B. PLL相对于参考时钟,可以输出分频、倍频、分数频的时钟 C. PLL输入的参考时钟jitter,在P ...
如果线网类型变量说明后未赋值,起缺省值是 z 电子系统设计优化,主要考虑提高资源利用率减少功耗 即面积优化 以及提高运行速度 即速度优化 ,下列方法 A 不属于面积优化。 A 流水线设计 B 资源共享 C 逻辑优化 D 串行化 reg : mema : 正确的赋值是 A A mema d B mema : d C mema d D 都正确 某设计中使用了DDR ,数据位宽 bit,FPGA工程中 ...
2021-04-28 09:48 0 384 推荐指数:
1.下面关于PLL电路表述正确的是: A. PLL属于模拟电路,无法用全数字电路实现 B. PLL相对于参考时钟,可以输出分频、倍频、分数频的时钟 C. PLL输入的参考时钟jitter,在P ...
3.1 请解释D触发器和Latch的区别,解释同步复位和异步复位的区别及优缺点。 一、D触发器和Latch的区别 Latch有电平触发,非同步控制。在使能信号有效时La ...
1.对于同步fifo,每100个cycle可以写入80个数据,每10个cycle可以读出8个数据,fifo的深度至少为? 写时钟频率 w_clk,读时钟频率 r_clk,写 ...
涉及数字IC功耗、验证、测试、时序、数电相关问题。 一、单选题 1.下列功耗措施哪个可以降低峰值功耗(B) A. Power Gating B. 大幅度提高HVT比例 C. 静态模块级Clock Gating D. Memory Shut Down 解析 ...
1. 在Verlog HDL中对于initial语句,说法错误的是() A. 在仿真过程中只执行一次 B. 可用于给实际电路赋初值 C. 在模拟的0 时刻开始执行 D. 多个 initial ...
1:什么是同步逻辑和异步逻辑?(汉王) 同步逻辑是时钟之间有固定的因果关系。异步逻辑是各时钟之间没有固定的因果关系。 同步时序逻辑电路的特点:各触发器的时钟端全部连接在一起, 并接在系统时 ...
一、单选题(共26题,每题2分,共52分) 1.[单选题]Verilog语言与C语言的区别,不正确的描述是( C ) A.Verilog语言可实现并行计算,C语言只是串行计算; B.Verilo ...
4.1 ASIC流程,说出5个以上环节;Verilog说出5个以上keyword。 4.2 用一个mux和一个反相器实现xor,画电路或Verilog代码实现。 4.3 ...