DDR2（3）：自定義讀寫控制器和DDR2 IP信號說明
官方的例程還是比較難懂，現在試着在上次的工程上進行修改，做一個簡單的讀寫測試。 一、新建頂層工程 建立工程 top.v，其效果即原先的 DDR2_example_top.v，記得右鍵設置為頂層模塊，主要修改了以下幾點： （1）端口信號名字； （2）增加 PLL 生成 100Mhz ...
原文：DDR信號、結構
DDR 信號 BA : address bus bank BA : address bus bank BG: bank group multi channel: 一個channel對應一個DDR controller，不同的channel之間工作是相互獨立的。 rank：在一個channel下，可以有多個rank，不同的rank有其獨立的CS CKE，但是一個channel下的不同rank的數據 ...
2020-10-12 19:47 0 407 推薦指數：
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