Vivado生成edf文件
https://china.xilinx.com/support/answers/54074.html 綜合完成后會跳出個框框，選擇open synthesis write_edif module.edf write_verilog -mode port ...
原文：Vivado生成及使用edf文件
前言 EDF文件可以直接導入Vivado，而無需Verilog源文件。 好處： 避免沙雕隊友修改源代碼，則可以直接提交EDF網表文件。 避免用戶剽竊勞動成果。 對於無需更改的設計復用，直接用EDF網表會賊方便。 軟件版本：Vivado . 流程 生成EDF網表文件 設置需提交的源代碼的最頂層為TOP層。可以看到內部調用了 個IP塊。 在設置選項的綜合設置中選中打平整個設計，防止別人看到模塊層次。 ...
2019-09-11 19:03 0 3475 推薦指數：
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