FPGA設計之——DDR3
一、硬件設計 1、DDR3顆粒一側，控制線、地址線線序不能交換； 2、DDR3顆粒一側，數據線可隨意交換； 3、FPGA一側，控制線、地址線、數據線均有專用引腳，需全部按要求連接。 這樣一是為了硬件布線能通，二是保證了FPGA分配引腳時不會亂，按照專用引腳規定的分配即可 ...
原文：FPGA DDR3調試
FPGA DDR 調試 Spartan FPGA芯片中集成了MCB硬核，它可以支持到DDR 。在Xilinx的開發工具Xilinx ISE中提供了MIG IP核，設計者可以用它來直接生成 DDR 控制器設計模塊，並通過 MIG 的 GUI 圖形界面完成相關配置。 首先，建立ISE工程，並添加MIG IP核， 接下來進行MIG IP核配置，這里列出主要的部分， 這里選擇DDR的類型，並選擇使用Spa ...
2016-07-06 19:49 1 17030 推薦指數：
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