对于电子工程师来说，很多电路设计仿真软件都是特别大的，安装下来一般都是上G，甚至几十G，而且win7的兼容性也是最好的，不愿意升级win10是因为麻烦，而且没有必要，对于很多的设计软件来说win1 ...

DDS直接数字式频率合成器（Direct Digital Synthesizer） 　　下面是使用MATLAB生成正弦波、三角波、方波的代码，直接使用即可。 　　设计DDS ...

最近由于项目需要，要将bit文件固化到zedboard的flash中，使程序上电自启，断电不丢失。 我们知道，一般板级调试的时候都是直接下载bit流到FPGA就行，固化到Flash的话，也是先生成. ...

Vivado中ILA的使用 1.编写RTL代码 其中需要说明的是(* keep = "TRUE" *)语句的意识是保持cnt信号不被综合掉，方便以后的调试，是否可以理解为引出这个寄存器信 ...

首先，要指出，本文不描述任何IP的功能与使用。 在开发一个大型FPGA项目时，多人协作是必不可少的。这个时候，如何提交设计给负责集成的人，是项目开发中最关键的问题之一。 常用的一个方法 ...

IP核（IP Core） Vivado中有很多IP核可以直接使用，例如数学运算（乘法器、除法器、浮点运算器等）、信号处理（FFT、DFT、DDS等）。IP核类似编程中的函数库（例如C语言中的prin ...

开发环境：xp vivado2013.4 基于AXI-Lite的用户自定义IP核设计 这里以用户自定义led_ip为例： 1.建立工程 和设计一过程一样，见vivado设计一http://b ...

下载器与板级之间的连接如下：有关iFPGA-Cable，可参考 iFPGA-Cable FT2232H Xilinx / Altera / Lattice 三合一JTAG & UART调试器 ...

本编文章的目的主要用简明的方法对DDR3进行读写，当然这种方式每次读写都需要CPU干预，效率是比较低的，但是这是学习的过程吧。 本系列文章尽可能的让每一个实验都相对独立，过程尽可能保证完整性，保证实 ...

　　 1、结构：MMCM和PLL 　　mixed-mode clock manager (MMCM)，phase-locked loop (PLL) 　　这两种primitive架构不同， ...