乐鑫科技2020秋招笔试题——数字IC
原题： 请将下面这段 C 语言描述的串行处理过程，转换为单拍完成的并行处理，并用可综合的 Verilog 来描述。 unsigned char cal_table_high_first(u ...
原文：FPGA/IC笔试——乐鑫2022提前批
注：提前批题型一般 道选择 道填空 两道问答 RTL代码 以下将多次笔试题汇总： 一 选择 .以下关于System Verilog的描述，正确的 D A：sv中可以用logic代替Verilog中的wire和reg类型 部分条件下不可代替，如：inout型端口只能用wire B：sv中，定义成reg的信号会被综合成触发器 在组合逻辑中不被综合为触发器，如：不完全组合逻辑中reg变量也可以对应为锁存 ...
2021-07-13 15:02 0 580 推荐指数：
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