FPGA基礎——鎖存器latch
一、是什么 鎖存器是一種在異步時序電路系統中，對輸入信號電平敏感的單元，用來存儲信息。一個鎖存器可以存儲1bit的信息，通常，鎖存器會多個一起出現，如4位鎖存器，8位鎖存器。 鎖存器在數據未鎖存時，輸出端的信號隨輸入信號變化，就像信號通過一個緩沖器，一旦鎖存信號有效 ...
原文：FPGA之鎖存器
前言 數字同步邏輯中應盡量避免產生鎖存器，因為鎖存器容易引起競爭 冒險，同時靜態時序分析工具也很難分析穿過鎖存器的路徑。FPGA里面的latch是由查找表產生的。 由於fpga生成的latch路徑和時延不確定，因此fpga內不建議用latch 除非一些場景必須使用組合邏輯和latch解決，且對latch的應用很了解 。 芯片IC設計的路徑和時延是固定的，因此IC設計是可以使用latch的。 一 ...
2022-02-16 09:27 0 1173 推薦指數：
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