【短篇】Verilog中 嵌套三目運算符（嵌套if-else） 和 函數case結構 的比較
本文是龍芯杯日志的一篇擴展短文，日志指路：【【龍芯杯日志】2020/11/19-2020/11/21: 單周期CPU】。 在寫單周期cpu的cu和alu時，涉及到命令解碼的代碼中，會出現通過指令操作碼 ...
原文：if-else和三目運算符 ? : 的對比
今天的地鐵思考讓我想起一個之前學C語言的時候一直沒有驗證的事情：既生瑜何生亮 平時寫代碼的時候，似乎並沒有太多的關注我應該選用什么條件判斷語句，感覺判斷條件或者兩條支路語句復雜就本能地if else。 遇到一些數值，字符的按條件賦值輸出，就感覺if else與這些簡短語句氣質不符，於是就用了三目運算符，使代碼更簡潔舒服。那么為什么有了if else還要用 ：呢，只是為了代碼更簡潔嗎，還是有什么不為 ...
2020-07-10 08:15 4 1314 推薦指數：
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