有時在基本模塊的設計中常常會使用到時鍾分頻，時鍾的偶分頻相對奇分頻來說比較簡單易於理解，但是奇分頻的理念想透徹后也是十分簡單的，本文就針對奇分頻做一個記錄並列出了 modelsim 的仿真結果。 奇分頻 其實現很簡單，主要為使用兩個計數模塊分別計數，得到兩個波形進行基本與或操作完成。一個 ...

一、為啥要說任意分頻 也許FPGA中的第一個實驗應該是分頻實驗，而不是流水燈，或者LCD1602的"Hello World"顯示，因為分頻的思想在FPGA中極為重要。當初安排流水燈，只是為了能讓大家看到效果，來激發您的興趣（MCU的學習也是如此）。 在大部分的教科書中，都會提到如何分頻，包括 ...

一、行波時鍾 　　任意分頻電路，相信很多人都聽說過這個專業名詞，好多視頻上都說不建議使用計數器產生的分頻時鍾。其實在ＦＰＧＡ領域當中，由寄存器分頻產生的時鍾還有一個學名叫做，行波時鍾。是由時序邏輯產生比如A寄存器的輸出作為B寄存的時鍾輸入（一般不建議使用），如下圖所示；驅動右邊那個觸發器的時鍾 ...

分頻器是用的最廣的一種FPGA電路了，我最初使用的是crazybingo的一個任意分頻器，可以實現高精度任意分頻的一個通用模塊，他的思想在於首先指定計數器的位寬比如32位，那么這個計數器的最大值就是2^32=4294967296， 假設系統時鍾為50MHz，那么假如要想實現輸出頻率為fout ...

　　<前注>：設計中盡量還是要避免使用自己計數分頻得到的時鍾，去使用廠家自帶的分頻IP（如Vivado中的clock wizard）。 >> 偶數分頻比較簡單，這里略過。 >> 對於不要求占空比為50%的奇數分頻，也比較簡單，直接模N計數，期間 ...

1.整數分頻電路，無占空比要求 對於偶數，N分頻電路，只需實現一個N/2個狀態的計數器即可，觸發器 采到計數器為N/2-1時，將clk_out取反。 對於奇數，N分頻電路，可用狀態機實現，前幾個狀態輸出0，后幾個狀態輸出1；也可用計數器實現，比如7分頻電路，計數器從0到6循環 ...

在學習FPGA的過程中，最簡單最基本的實驗應該就是分頻器了， 同時分頻器也是FPGA設計中使用頻率非常高的基本設計之一， 盡管在芯片廠家提供的IDE中集成了鎖相環IP， 如altera 的PLL，Xilinx ISE的DLL或者vivado中的clock來進行時鍾的分頻，倍頻以及相移 ...

在一個數字系統中往往需要多種頻率的時鍾脈沖作為驅動源，這樣就需要對FPGA的系統時鍾（頻率太高）進行分頻。分頻器主要分為奇數分頻，偶數分頻，半整數分頻和小數分頻，在對時鍾要求不是很嚴格的FPGA系統中，分頻器通常都是通過計數器的循環來實現的。 偶數分頻：假設為N分頻，由待分頻的時鍾觸發計數器計數 ...