實驗四 時序邏輯電路的VHDL設計
一、實驗目的 熟悉QuartusⅡ的VHDL文本設計過程，學習簡單時序邏輯電路的設計、仿真和測試方法。 二、實驗 1. 基本命題 用VHDL文本設計觸發器，觸發器的類型可任選一種。給出程序設計、仿真分析、硬件測試及詳細實驗過程。 ① 實驗原理 由數電知識可知，D觸發器由輸入的時鍾信號 ...
原文：【FGPA】VHDL實驗
實驗一簡單的QUARTUSII實例設計 一 實驗目的 通過一個簡單的 譯碼器的設計,掌握組合邏輯電路的設計方法。 初步了解QUARTUSII原理圖輸入設計的全過程。 掌握組合邏輯電路的靜態測試方法。 二 實驗原理 譯碼器三輸入，八輸出。當輸入信號按二進制方式的表示值為N時，輸出端標號為N的輸出端輸出高電平表示有信號產生，而其它則為低電平表示無信號產生。因為三個輸入端能產生的組合狀態有八種，所以輸 ...
2020-06-25 18:09 0 676 推薦指數：
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