AD9361框圖
1、 Fir濾波器的階數為64或128 而內插或抽取因子為：1、2或4。 HB1和HB2的內插或抽取因子為1或2而HB3的因子為1、2或3 BB_LPF為：三階巴特沃斯低通濾波器，3d ...
原文：記錄采用Xilinx ZYNQ系列板卡+AD9361實現簡單2x2 MIMO通信過程
寫在最前，本文對MATLAB提供的例程做了一些檢索和解讀，並在自己的需求上做了更改。 最近一段時間老師不知道在研究些啥，突然之間對硬件產生了濃厚的興趣，並且為我們 級的新生購置了幾塊SDR設備。雖然不知道為什么，但是拿着這些板子也可以作為無聊的宅家消遣，畢竟我已經半年沒有去過學校了。 軟件 硬件 准備 硬件 本次使用到的硬件為ZedBoard，是一塊Xilinx ZYNQ 系列的開發板，該開發板 ...
2020-07-15 14:08 3 2390 推薦指數：
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AD9361框圖 1、 Fir濾波器的階數為64或128 而內插或抽取因子為：1、2或4。 HB1和HB2的內插或抽取因子為1或2而HB3的因子為1、2或3 BB_LPF為：三階巴特沃斯低通濾波器，3dB點頻率可編程，頻率可編程范圍為：Tx ...
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LO的產生過程如圖： 各個模塊都有高靈活性。 1、參考時鍾即是AD9361全局參考時鍾，可以是外接晶振的片上DCXO，或是外部輸入的有驅動能力的時鍾信號。根據FM-COMMS5的設計，參考時鍾可以使用時鍾Buffer + 40MHz晶振構成的參考頻率源。 （1）關於DCXO ...
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Xilinx Zynq 環境交叉編譯 Thrift 記錄
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