數字電路 第六章 時序邏輯電路
第六章 時序邏輯電路 目錄 第六章 時序邏輯電路 6.1 概述 6.1.1 時序邏輯電路的特點 6.1.2 時序電路的一般結構形式與功能描述方法 6.1.3 時序電路的分類 6.2 ...
原文：VLSI基礎-- 第六章 時序邏輯電路
第六章 時序邏輯電路 目錄 第六章 時序邏輯電路 . 組合電路和時序電路的區別 . 狀態機 . 雙穩態結構 . 靜態存儲電路 a. Latch b. D觸發器 寄存器 Register的工作方式與Verilog中非阻塞賦值的匹配 減少時鍾負載的靜態主從寄存器 非理想時鍾的影響 時鍾交迭 overlap c. RS 觸發器 Flip Flop 動態Latch和Register 動態傳輸門邊沿觸發寄存 ...
2020-02-24 23:30 0 1015 推薦指數：
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