大疆2019校招FPGA筆試總結
1.對於同步fifo，每100個cycle可以寫入80個數據，每10個cycle可以讀出8個數據，fifo的深度至少為？ 2.如果只使用2選1mux完成異或邏輯，至少需要幾個mux？ ...
原文：大疆2019校招FPGA筆試總結
轉載： .對於同步fifo，每 個cycle可以寫入 個數據，每 個cycle可以讀出 個數據，fifo的深度至少為 .如果只使用 選 mux完成異或邏輯，至少需要幾個mux 一開始想到的答案如下，需要 個，未詳加驗證： 后來經人指正發現確實不太對，糾正為至少需要兩個，如下圖： .在對信號采樣過程之前抗混濾波,其作用是什么 它選用何種濾波器 其截止頻率如何確定 .線與邏輯 線與邏輯是兩個輸出信號相 ...
2018-08-31 10:56 0 3545 推薦指數：
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