基於FPGA的DDS設計（二）
在DDS設計中，如果相位累加器每個時鍾周期累加1，就會輸出頻率為195.313KHz的波形。如果每個時鍾周期累加2，就會輸出頻率為2*195.313KHz的波形·······，如果每兩個時鍾周期累加1，就會輸出195.313/2KHz的波形······，如果按照這樣來設計話，不太方便並且輸出 ...
原文：基於FPGA的DDS設計（一）
最近在學習基於FPGA的DDS設計，借此機會把學習過程記錄下來，當作自己的學習筆記也希望能夠幫助到學習DDS的小伙伴。 DDS Direct Digital Synthesizer 直接數字合成器，這是直譯過來的名字。設計人員一般把它叫做信號發生器，用它來產生一些數字意義上的波形。它的意義還是挺大的，例如我們學習濾波器，就需要一個高低頻率疊加的波形，現時生活中到處都是，可以在設計中，怎么能做出這 ...
2018-08-20 11:52 0 8970 推薦指數：
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