如何將自己寫的verilog模塊封裝成IP核
如何將自己寫的verilog模塊封裝成IP核 (2014-11-21 14:53:29) 轉載▼ 標簽： 財經 分類： 我的東東 ...
原文：將自己寫的HDL代碼封裝成帶AXI總線的IP
將自己寫的HDL代碼封裝成帶AXI總線的IP .Tools gt create and package IP .create AXI 總線的IP .新建block design .點擊右鍵，選擇edit in ip packager 此時生成了一個新的工程： .對生成的.v文件進行編輯 .先修改頂層文件 添加一個LED輸出端口 其實在文件的下面還可以添加自己的邏輯： .修改源文件 先添加端口，下面 ...
2017-06-28 17:39 0 1371 推薦指數：
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