靜態時序分析SAT
1. 背景 靜態時序分析的前提就是設計者先提出要求，然后時序分析工具才會根據特定的時序模型進行分析，給出正確是時序報告。 進行靜態時序分析，主要目的就是為了提高系統工作主頻以及增加系統的穩定性。對很多數字電路設計來說，提高工作頻率非常重要，因為高工作頻率意味着高處理能力 ...
原文：（轉）讓你徹底理解：靜態時序分析
估計面試的時候都會讓大家解釋一下建立時間和保持時間，幾乎所有人都能背出來。建立時間 setup time ：時鍾的有效沿到來之前數據必須提前穩定的時間。保持時間 hold time ：時鍾有效沿到來之后數據必須繼續保持穩定的時間。 我們知道，整個ASIC設計流程主要兩個目的：功能和性能。 除了要保證設計的功能，另外一個就是要保證性能。性能通俗的講，主要是看電路跑得多快，也就是時鍾頻率有多高。保證性 ...
2016-08-18 07:14 0 2917 推薦指數：
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