Verilog中的文件的讀取和寫入
在仿真驗證的時候，需要一個合適的數據激勵，在testbech一個一個的寫很麻煩，如果能直接從數據文本里讀取，然后輸入到已經編寫好功能程序中，就很方便。 還有的時候，我們需要將程序輸出的內容寫到文本里面，然后用其他工具（例如matlab、python等）進行處理。 代碼和解釋說明如下： ...
原文：Verilog利用$fdisplay命令往文件中寫入數據
最近在做的事情是，用FPGA生成一些滿足特定分布的序列。因此為了驗證我生成的序列是否擁有預期的性質，我需要將生成的數據提取出來並且放到MATLAB中做數據分析。 但是網上的程序很亂，表示看不懂 其實特別簡單的一個命令，不知道別人為什么搞那么復雜。 在testbench里面寫的主要語句： integer handle 定義后面要用到的變量 ... ... handle fopen data.txt ...
2016-08-17 16:55 0 11451 推薦指數：
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