利用Xilinx HLS實現LDPC譯碼器
1. 概述 采用Xilinx HLS快速實現的部分並行，全流水的LDPC譯碼器。 環境：Vivado HLS 2018.2 碼字：IEEE 802.16e 2/3A 算法：Min-Sum Algorithm 代碼：https://github.com/cea-wind ...
原文：LDPC譯碼器的FPGA實現
應用筆記 V . LDPC譯碼器的FPGA實現 概述 本文將介紹LDPC譯碼器的FPGA實現，譯碼器設計對應CCSDS x o s文檔中提到的適用於深空通信任務的LDPC編碼。本文檔將簡述Verilog代碼的基本結構和信號說明。 修訂歷史 以下表格展示了本文檔的修訂過程 日期 版本號 修訂內容 V . 初始版本，ISim仿真基本正確 簡介 本文中FPGA實現特指通過Verilog HDL實現LD ...
2015-03-19 20:42 13 2380 推薦指數：
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