**參考
http://www.cnblogs.com/crazybingo/archive/2012/03/02/2376640.html
---By SOCquan
1 聯合功能仿真l quartus 11.1中編寫好代碼,舉例如下:

進行編譯以檢查錯誤;
自動生成testbeach文件
注意要先設置simulation方式為modelsim;
設置:Assignments---->settings:
查看quartus II 仿真時是否已關聯modelsim的安裝目錄:
Tools –>Options –>在General里選EDA Tool Options:
生成testbeach文件
生成成功
打開testbeach文件
一般在…\simulation\modelsim文件夾中,后綴是.vt
完善teshbeach文件:
進行仿真設置: 完成NativeLink settings:
選擇compile Test bench:
選擇Test Benches…
點擊new…填寫完test bench name 和top level module in test bench后,點擊file name后的…
之后點擊Add:
最終設置
運行仿真:Tools—>run simulation tool—>RTL simulation
得到波形圖
2 仿真“深度”調試
當源文件或者testbeach出現修改時,需要按以下步驟重新得到仿真結果
重新編譯修改文件
選擇Complile->complile,選擇被修改的文件重新編譯
復位仿真
在modelsim命令欄鍵入restart,回車運行
出現restart菜單,點擊ok
設置仿真時間:在命令欄鍵入run 3000ns,設置仿真運行時間
此時,已得到源文件或testbeach修改后的仿真結果
注:我們可以繼續通過鍵入run xxns 增加仿真時間
3 自動運行—腳本文件編寫
這里主要講如何將功能仿真結果的波形圖進行保存,以便下次快速運行。
完善保存波形圖
得到波形圖后,可以先對波形圖進行完善:添加感興趣信號,設置字體波形顏色,縮小放大……
然后保存波形圖 file->save format… 一般默認保存名字為wave.do,保持默認路徑,
設置wave.do
在工程目錄下打開…\simulation\modelsim文件夾
分別打開兩個do文件,一個是quartus自動生成的divider_run_msim_rtl_verilog.do,
一個是保存的wave.do
divider_run_msim_rtl_verilog.do
此文件是modelsim自動運行命令,復制圖中部分
即
vmap …(該命令的作用是將目前的邏輯工作庫work和實際工作庫work映射對應)
vlog …(該命令的作用是編譯這些文件,默認編譯到work庫下)
vsim …(仿真work庫中名為激勵文件)
wave.do
此文件是modelsim波形窗口設置
添加入wave.do中的前面,並在最后添加運行命令,如run 3000ns
復制后
保存文件
自動運行
重新打開modelsim
輸入命令 cd E:/EDA/modelsim/Quartus_modelsim/simulation/modelsim
指向目標文件夾,即wave.do與divider_run_msim_rtl_verilog.do的位置,注意不是“\”是“/”
最后輸入命令 do wave.do即可
另一種仿真深度調試方式
我們將工程文件修改為自加2,保存
繼續仿真只需要在2中結果中
Ø 關掉wave窗口
Ø 輸入命令quit –sim退出仿真
Ø 重新輸入命令 do wave.do
4 仿真工程可移植性修改
上面的腳本文件限定了工程的指定目錄,為了使工程復制到不同的目錄下后仿真依然可以自動運行,需要進行地址修改
將上圖選中部分進行以下修改,並保存
當工程位置被修改后,即可重新
輸入命令 cd 指向目標文件夾,然后輸入do wave.do自動運行
5 聯合時序仿真
(1)如在一開始設置中,選中在編譯后自動進行門級仿真(時序仿真),軟件會在編譯后自動進行仿真,知道仿真結束,設置如下圖:
(2)當然,也可以在功能仿真的基礎上,直接Run gate level仿真即時序仿真
(3)Quartus II + Modelsim自動加載就可以得到時序結果。























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