关于DDR3布线规范和技巧
转自于：http://blog.csdn.net/qq_29350001/article/details/51781419 关于DDR3布线的一些规范(个人总结)本规范为个人总结，介绍得比较简单。当然，具体规范不止这么点。写得不好的地方还请见谅。1. 一、阻抗方面 ...
原文：DDR 布线规范
DDR 管脚定义 CK CK 全局差分时钟，所有控制和地址输入信号在CK上升沿和CK 的下降沿交叉处被采样，输出数据选通 DQS DQS 参考与CK和CK 的交叉点。 CKE为时钟使能信号，使能 高 和禁止 低 内电路和DRAM上的时钟。由DDR SDRAM配置和操作模式决定特定电路被使能和禁止。CKE为低时，提供预充电和自刷新操作 所有Bank都处于空闲 ，或有效掉电 在任何Bank里的行有效 ...
2021-07-13 18:50 0 160 推荐指数：
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