怎么用Verilog语言描述同步FIFO和异步FIFO
感谢 知乎龚大佬 打杂大佬 网上几个nice的博客（忘了是哪个了。。。。） 前言 虽然FIFO都有IP可以使用，但理解原理还是自己写一个来得透彻。 什么是FIFO？ Fist in first out。先入先出的数据缓存器，没有外部读写地址线，可同时读写。 规则：永远不要写一个已经 ...
原文：校招Verilog——同步FIFO和异步FIFO
一 同步FIFO 代码 仿真 二 异步FIFO 分析 格雷码 比较空满时，需要读写地址进行判断，二者属于跨时钟域，需要进行打拍的同步处理，未避免亚稳态，采用格雷码，因为格雷码相邻只有一位变化，这样同步多位时更不容易产生问题。 读空判断 默认是先写后读，读追上了写，之后就是读空了。因此读空标志为 读写地址相同 。 写满判断 默认是先写后读，写在前面，超过了一轮地址后，又追上了读，之后就是写满了。因此 ...
2020-08-16 16:37 3 1357 推荐指数：
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