Verilog HDL基本语句
1.过程语句 Verilog中有两种结构化过程语句：initial和always语句，是行为建模的两种基本语句，所有的行为语句只能出现在这两种结构化过程语句里。 每个initial语句和always语句代表一个独立的执行过程（或过程块）。 一个模块可以包含多条always语句和多条 ...
原文：Verilog HDL模型的不同抽象级别
所谓不同的抽象类别，实际上是指同一个物理电路，可以在不同层次上用Verilog语言来描述。如果只从行为功能的角度来描述某一电路模块，就称作行为模块。如果从电路结构的角度来描述该电路模块，就称作结构模块。根据抽象的级别将Verilog的模块分为 种不同的等级: 系统级 算法级 RTL级 register transfer level 门级 开关级。 对于数字系统的逻辑设计工程师而言：熟练地掌握门级 ...
2016-09-28 16:31 0 2860 推荐指数：
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