Verilog 奇数分频
代码： 这个代码比较简单，而且为了仿真方便，将dut和bench写在一个模块了。。。。 代码设计思路来自这个帖子 https://blog.csdn.net/lt66ds/article/details/10035187 DIV_PARA参数设置分频系数 ...
原文：奇数分频
奇数分频思路： 结合图示进行理解 第一步：在时钟的上升沿和下降沿分别产生一个计数器。cnt up 在时钟上升沿计数，cnt down 在时钟下降沿计数 例：如果是 N 分频，就从 计数到 N 第二步：根据这两个计数器产生两个控制信号 clk up , clk down。 注意：clk up 和 clk down 的高低电平的比例是有规律的。 如果是N分频，比例为 N : N 或者N : N 如果 ...
2016-09-03 23:55 3 2827 推荐指数：
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