FPGA中的ODDR2的使用
ODDR2整體結構如下圖： ODDR2真值表 相關說明：轉載：http://blog.sina.com.cn/s/blog_6ad065eb0101krwj.html http://blog.sina.com.cn/s ...
原文：ODDR使用注意
最近項目用到了千兆以太網，PHY通過ZYNQ的PL管腳進入FPGA后，直接連到PS端的MAC，PL端使用ODDR保證MAC發送的Tx信號到PHY的接收時序， PHY用的是TI的DP ，沒注意這貨在GMII的模式下不能調整clock和Data的相位關系，結果FPGA保證了沿對齊，PHY也是沿對齊去采集，導致不同批次的硬件表現不一致 血的教訓啊。 記錄下ODDR的輸出模式： clk wire和輸出的 ...
2021-01-14 18:42 0 389 推薦指數：
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