xilinx DMA IP核(二) —— 文檔閱讀
本筆記不記錄DMA的Scatter/Gather特性。DMA上有三種總線：AXI4-LIte（對寄存器進行配置），AXI4-Memory Map（用於與內存交互）和AXI4 Stream（用於與外設交互）。在寄存器模式下，寄存器分為兩部分：MM2S和S2MM，每個部分包括Control ...
原文：xilinx DMA IP核(一) —— loop測試 代碼注釋
本篇筆記中的代碼來自：米聯科技的教程 第三季第一篇的DMA LOOP環路測試 硬件的連接如下圖所示： 圖：DMA Loop Block Design 橘色的線就是DMA加FIFO組成的一個LOOP循環，紅色圈圈是AXI LITE的控制和兩個讀寫完成的中斷。 米聯科技教程提供的該測試代碼文件是以下四個，我刪除了其中關於OLED的部分。 圖：DMA Loop 測試源碼結構 .重要的結構體 . .中斷 ...
2019-02-11 14:32 0 2489 推薦指數：
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