System Verilog基礎（一）
學習文本值和基本數據類型的筆記。 1.常量（Literal Value） 1.1.整型常量 例如：8‘b0 32'd0 '0 '1 'x 'z 省略位寬則意味着全位寬都被賦值。 例 ...
原文：System Verilog基礎（二）
這一篇筆記主要記錄Procedural，Process，Task and function，Interface和Communication中值得注意的點。 .Procedural 寫testbench的時候，除了tb與硬件交互的地方使用非阻塞賦值，tb里面其他地方一律用阻塞賦值，OK Loop循環中的foreach，是專門針對數組輪詢時候用的。對二維數組遍歷，如下代碼： 在兩個for循環中，可以 ...
2019-01-27 11:31 0 2373 推薦指數：
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