DC學習（2）綜合的流程
一：邏輯綜合的概述 synthesis = translation + logic optimization + gate mapping 1：Translation 主要把描述RTL級的HDL語言，在約束下轉換成DC內部的同意用門級描述的電路，以GTECH或者沒有映射的ddc形式 ...
原文：DC學習（11）綜合產生的文件
一：綜合產生的文件 前面也講了一些綜合后的需要進行的一些工作，這里就集中講一下DC完成綜合了，產生了一些文件，我們就要查看它生成的網表和信息，下面就來介紹DC綜合完成之后要進行哪些工作： 也就是說，DC一般完成綜合后，主要生成.ddc .def .v和.sdc，.sdf格式的文件 當然還有各種報告和log .sdc文件：write sdc version . filename.sdc 標准延時約束 ...
2018-04-11 20:30 0 1106 推薦指數：
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DC綜合簡單總結（1） *****************set_dont_touch和set_dont_touch_network**************** ？ 在綜合的過程中，為了不讓DC工具自動優化一些我們不希望其優化的模塊（比如CLK）我們通常都會設置 ...
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