如何高效的編寫Verlog HDL——菜鳥版
工欲善其事、必先利其器！要想高效的編寫verilog沒有一個好的編輯器可不行，所以我這里推薦兩款十分好用的編輯器Notepad++和Gvim，這兩款編輯器由於其強大的添加插件的功能，所以深受代碼工作者的喜愛，那么對於FPGA新手而言，我覺的去學較復雜的gvim編輯指令，那就有點本末倒置 ...
原文：如何高效的編寫Verilog HDL——進階版
博主之前寫過一篇文章來談論如何高效的編寫Verlog HDL 菜鳥版，在其中主要強調了使用Notepad 來編寫Verilog HDL語言的便捷性，為什么說是菜鳥版呢，因為對於新手來說，在還沒有熟悉軟件和硬件描述語言的時候，使用Notepad 不需要學習成本，幾分鍾就能用好，利用其中一些功能，便能相對快捷高效的編寫代碼。很多人習慣了使用Notepad ，包括我在內。但是當我遇見了它 Vim。相對 ...
2018-03-05 08:31 0 5694 推薦指數：
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