【設計開發】 典型異步電路設計-脈沖同步（2）
一、前言 上一篇文章中已經描述了簡單的脈沖同步器，它可以實現簡單應用場景下的同步功能，同時也存在不少應用限制或缺陷，例如： （1） 對src_clk域dst_clk關系較為敏感，當src_clk與dst_clk時鍾頻率差別很大時可能不適應； （2） 由於沒有完整的握手機制，當多個 ...
原文：【設計開發】 典型同步電路設計- 同步FIFO
一 前言 FIFO First In First Out 是一種先進先出的數據交互方式，在數字ASIC設計中常常被使用。FIFO按工作時鍾域的不同又可以分為：同步FIFO和異步FIFO。 同步FIFO的寫時鍾和讀時鍾為同一個時鍾，FIFO內部所有邏輯都是同步邏輯，常常用於交互數據緩沖。異步FIFO的寫時鍾和讀時鍾為異步時鍾，FIFO內部的寫邏輯和讀邏輯的交互需要異步處理，異步FIFO常用於跨時鍾域 ...
2016-11-27 23:18 0 8327 推薦指數：
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