靜態時序分析(static timing analysis) --- 時序路徑
時序分析工具會找到且分析設計中的所有路徑。每一個路徑有一個起點(startpoint)和一個終點(endpoint)。起點是設計中數據被時鍾沿載入的那個時間點，而終點則是數據通過了組合邏輯被另一個時間沿載入的時間點。 路徑中的起點是一個時序元件的時鍾pin或者設計的input port ...
原文：靜態時序分析(static timing analysis)
靜態時序分析 static timing analysis，STA 會檢測所有可能的路徑來查找設計中是否存在時序違規 timing violation 。但STA只會去分析合適的時序，而不去管邏輯操作的正確性。 其實每一個設計的目的都相同，使用Design Compiler和IC Compile來得到最快的速度，最小的面積和最少的耗能。根據設計者提供的約束，這些工具會在面積，速度和耗能上做出權衡。 ...
2016-09-15 14:14 0 4581 推薦指數：
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