使用matlab和ISE 創建並仿真ROM IP核
前言 本人想使用簡單的中值濾波進行verilog相關算法的硬件實現，由於HDL設計軟件不能直接處理圖像，大部分過程都是可以將圖像按照一定的順序保存到TXT文檔中，經過Modelsim仿真后，處理的數據再經過matlab顯示圖像；圖像首先通過matlab或者C語言保存在TXT文檔中，生成測試 ...
原文：ip 核生成 rom 及questasim仿真時需要注意的問題
IP 核生成 ROM 步驟 ：Tools gt MegaWizard Plug In Manager 步驟 ：Create a new custom megafuction variation 步驟 ：Memory Compier gt ROM gt Verilog HDL gt 自定義名稱 步驟 ： 步驟 ： 步驟 ： 步驟 ： questasim仿真注意問題 仿真時要注意是否有 altera ...
2016-08-17 15:08 0 2046 推薦指數：
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