sublime text3 verilog代碼編寫高級操作篇
2018.10.21 好久沒寫博客了，這段時間一直在學習一直在沉淀，然而發現學的越多會的更少，只能快馬加鞭吧！ 博主從大一暑假接觸FPGA，到現在快一年半了，時間恍逝。剛開始入門也是用的quartus自帶的編輯器，后來改用notepad++編寫代碼，界面比quartus簡介好看。再后來或者最近 ...
原文：用Sublime Text搭建簡易IDE編寫Verilog代碼
前言 Verilog是一種硬件描述語言 HDL ，該語言在Windows上有集成開發環境可以使用，如ModelSim，但ModelSim的編輯器不太好用因此筆者萌生了用Sublime Text 來編寫Verilog的想法。下面我們將圍繞着Sublime Text 搭建起一個簡易的IDE， 我將盡量把步驟寫的細致一點，這將會使整個過程看起來很繁瑣，但這是值得的。 原材料 Sublime Text 訪 ...
2016-05-17 20:17 1 3011 推薦指數：
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