靜態時序分析（STA）基礎
注：上海交大論文《數字電路靜態時序分析與設計》—學習筆記 第一章 概述 1.4 集成電路的設計流程 一般集成電路設計步驟分為邏輯設計和物理設計如圖1-1 所示： 邏輯設計包括： 系統划分：將一個大規模的系統按功能分成幾個功能模塊 設計輸入：用HDL(Hardware ...
原文：FPGA STA(靜態時序分析)
FPGA設計過程中所遇到的路徑有輸入到觸發器，觸發器到觸發器，觸發器到輸出，例如以下圖所看到的： 這些路徑與輸入延時輸出延時，建立和保持時序有關。 . 應用背景 靜態時序分析簡稱STA，它是一種窮盡的分析方法。它依照同步電路設計的要求。依據電路網表的拓撲結構，計算並檢查電路中每個DFF 觸發器 的建立和保持時間以及其它基於路徑的時延要求是否滿足。 STA作為FPGA設計的主要驗證手段之中的一個， ...
2016-02-06 10:27 1 5646 推薦指數：
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