基於verilog狀態機的交通燈演示
設計要求：設計一個簡易的交通燈（系統時鍾1hz共陰極）。南北方向為主干道（L3~L1),綠燈時間為29s；東西方向為次干道（L6~L4),綠燈時間為19s；在一個方向從紅燈轉綠燈前3s，另一個方向黃燈亮3s。 S1 S2 S3 ...
原文：verilog狀態機實現的簡單交通燈
module lxl clk,rst,led,sel,dig input clk,rst output reg : led output reg : sel output : dig parameter s b ,s b reg current state,next state parameter T s d reg : t reg : cnt,cnt wire w reg clk out alw ...
2013-06-23 10:17 0 3331 推薦指數：
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