verilog之display


verilog之display

1、函數簡介

$display是用於顯示不同格式的變量的函數,用於測試過程中觀察數據數據的特點。該觀測不如波形圖直觀,但是如果可以詳細的設置好觀測點,有時可以達到事半功倍的效果。

2、實際測試

module display;
    
/* 數據類型簡寫
%h或%H 以十六進制數的形式輸出
%d或%D 以十進制數的形式輸出
%o或%O 以八進制數的形式輸出
%b或%B 以二進制數的形式輸出
%c或%C 以ASCII碼字符的形式輸出
%v或%V 輸出網絡型數據信號強度
%m或%M 輸出等級層次的名字
%s或%S 以字符串的形式輸出
%t或%T 以當前的時間格式輸出
%e或%E 以指數的形式輸出實型數
%f或%F 以十進制數的形式輸出實型數
%g或%G 以指數或十進制數的形式輸出實型數,無論何種格式都以較短的結果輸出
*/    
/*轉義字符
\n 換行
\t 橫向跳格(即跳到下一個輸出區)
\\ 反斜杠字符\
\" 雙引號字符"
\o 1到3位八進制數代表的字符
%% 百分符號%
*/
/*功能區分
$display自動地在輸出后進行換行,
$write則不是這樣。如果想在一行里輸出多個信息,可以使用$write
*/
/*具體例子
*/
reg [3:0] a;
initial begin
a=1'b1;
$display("\\ \" \t \o %d %% \n",a);
$display("a= %d",a);
$display("a= %d",a);
$write("a= %d",a);
$write("a= %d",a);
end
endmodule

3、測試結果

run -all
# \ "      o  1 % 
# 
# a=  1
# a=  1
a=  1a=  1

可以看到display顯示分行,而write只是在同一行工作。一個成段,一個成句,基本功能還是一致的。


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