摘自:《xilinx FPGA 開發實用教程》
1）被除數重復的減去除數，直到檢測到余數小於除數為止,優點：對於除數與被除數相差較小的情況下合適
2）通過如下圖片方式實現+狀態機。優點：挺好的自己用硬件實現的方法
3）通過FPGA自帶的DSP實現，即直接使用"/"，優點：速度快
4）用FPGA自帶的IP核
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1）被除數重復的減去除數，直到檢測到余數小於除數為止,優點：對於除數與被除數相差較小的情況下合適
2）通過如下圖片方式實現+狀態機。優點：挺好的自己用硬件實現的方法
3）通過FPGA自帶的DSP實現，即直接使用"/"，優點：速度快
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