数字asic流程实验（一） 环境准备 1.前言 该系列博客主要参考北京理工大学《基于标准单元法数字集成电路设计》实验课程指导书，进行了数字ASIC从设计到实现所需要的源代码（Verilog）编写， ...

数字asic流程实验（五） ICC布局布线 1.IC Compiler简介 IC Compiler（以下简称ICC）是Synopsys公司用于把门级网表转换成代工厂可用于掩膜的版图信息的工具。其基 ...

数字asic流程实验（二） CIC滤波器原理简述 1.概述 本次实验需要实现的数字ASIC为一个CIC滤波器，CIC滤波器是一种FIR数字滤波器，其优点为结构简单，与一般的FIR数字滤波器相比，不 ...

数字asic流程实验（六） 静态时序分析&等效性检验&后仿真 1.静态时序分析 PrimeTime（以下简称PT）是Synopsys的一个全芯片、门级静态时序分析工具，是当今大型芯 ...

数字asic流程实验（四） DC综合 1.Design Compiler 简介 Design Compiler（以下简称DC）是Synopsys公司用于做电路综合的核心工具，可以将HDL描述的电路 ...

数字asic流程实验（三） Verilog编写&前仿真 1.Verilog编写 本次实验要实现的是一个三级抽取CIC滤波器，抽取系数为64。回顾上一章节中的CIC滤波器结构，可以发现其硬件 ...