高速逻辑电平LVDS、LVPECL、CML
转自： https://blog.csdn.net/weixin_44987757/article/details/108230626 1.TTL、CMOS电平不适用于高速应用的原因： （1）电平幅度大，信号高低电平之间的转换时间长，不适用于传输频率达到200MHZ以上的信号 ...
原文：LVDS与LVPECL简介与电平标准
LVPECL: low voltage positive emitter couped logic ECL:发射极耦合逻辑是数字逻辑的一种非饱和形式 简称ECL ，它可以消除影响速度特性的晶体管存储时间，因而能实现高速运行。发射极耦合是指电路内的差动放大器以发射极相连接，使差动放大器的输入阻抗高 电压增益大电路的输出部分为射极跟随器，以便恢复逻辑电平，降低输出阻抗，因而整个电路扇出容量大，驱动后续 ...
2022-04-13 15:27 0 5008 推荐指数：
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