FPGA DDR3调试
FPGA DDR3调试 Spartan6 FPGA芯片中集成了MCB硬核，它可以支持到DDR3。在Xilinx的开发工具Xilinx ISE中提供了MIG IP核，设计者可以用它来直接生成 DDR3 控制器设计模块，并通过 MIG 的 GUI 图形界面完成相关配置。 首先，建立ISE工程 ...
原文：FPGA设计之——DDR3
一 硬件设计 DDR 颗粒一侧，控制线 地址线线序不能交换 DDR 颗粒一侧，数据线可随意交换 FPGA一侧，控制线 地址线 数据线均有专用引脚，需全部按要求连接。 这样一是为了硬件布线能通，二是保证了FPGA分配引脚时不会乱，按照专用引脚规定的分配即可。 如此设计，FPGA写DDR 时，写地址正常翻译，写入的数据是乱序的，但对应读也是乱序的，所以FPGA读出来的数据和写入的数据相同，且和用户逻辑 ...
2021-12-30 10:34 0 1213 推荐指数：
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