verilog--实现数据的串并转换
并行转串行--用这个测试用例是最简单易懂的，这个测试用例需要使用使能信号端。当然还可以用计数器就稍微麻烦一点。 module parallel(clk, rst_n, en, din, dout); ...
原文：Verilog--带双向握手的乒乓BUFFER
网上没什么比较好的乒乓sram设计，有的还需要收费，于是自己写了一个Verilog源码，与大家讨论与学习。 一：介绍 乒乓操作 是一个常常应用于数据流控制的处理技巧， 典型的乒乓操作方法如图 所示。 乒乓操作的处理流程为：输入数据流通过 输入数据选择单元 将数据流等时分配到两个数据缓冲区， 数据缓冲模块可以为任何存储模块， 比较常用的存储单元为双口RAM DPRAM 单口RAM SPRAM FI ...
2021-10-18 14:44 0 3659 推荐指数：
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Verilog设计Valid-Ready握手协议
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实现一个双向流水灯，从右往左流动，到最左边时，再从左边往右流动，然后再从右边开始流动，如此不断反复。灯亮、间隔时间都为0.2s，本实验共有四个LED灯，从左到右依次为LED[3]、LED[2]、LED[1]、LED[0]，FPGA输出低电平点亮。 实现思路： 1. 定义一个0.2s的计数器 ...