FPGA基础学习(11) -- FIFO设计（style#1）
FIFO是跨时钟域数据传输中常用的缓存器。一般情况下，自己设计的异步FIFO（无特殊说明以下均简称FIFO）虽然能应付90~99%的场景，但是由于设计缺陷，导致在1%的极端情况下会出问题，还不容易发现，所以设计合理的FIFO至关重要。 对于同步FIFO，因为读写属于同一时钟域，可以直接采用 ...
原文：FPGA基础学习(11) -- FIFO设计（style#2）
在上一篇FIFO设计 stlye 中总结了论文 Simulation and Synthesis Techniques for Asynchronous FIFO Design 提出的FIFO设计的第一种方法，本篇博客总结第二种方法，源自论文 Simulation and Synthesis Techniques for Asynchronous FIFO Design with Asynchro ...
2020-03-07 18:23 2 745 推荐指数：
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