基于FPGA的异步FIFO设计
今天要介绍的异步FIFO，可以有不同的读写时钟，即不同的时钟域。由于异步FIFO没有外部地址端口，因此内部采用读写指针并顺序读写，即先写进FIFO的数据先读取（简称先进先出）。这里的读写指针是异步的，处理不同的时钟域，而异步FIFO的空满标志位是根据读写指针的情况得到的。为了得到正确的空满标志位 ...
原文：异步fifo设计（1）
异步fifo的设计主要涉及读写指针的产生，空满状态的判断 一：简单讲解 重要参数：fifo深度 简单来说就是需要存多少个数据 fifo位宽 每个数据的位宽 FIFO有 同步和 异步两种，同步即读写时钟相同，异步即读写时钟不相同 同步FIFO用的少，可以作为数据缓存 异步FIFO可以解决跨时钟域的问题，在应用时需根据实际情况考虑好fifo深度即可 本次要设计一个异步FIFO，深度为 ，位宽也是 二： ...
2018-07-04 19:52 1 1915 推荐指数：
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