Error (10278): Verilog HDL Port Declaration error at **.v(21): input port "**" cannot be declared with type "type, e.g. reg>"
错误原因：端口声明错误 解决办法：比如input端口不能被定义为reg类型 ...
原文：[转]Cannot deserialize the current JSON array (e.g. [1,2,3]) into type
...
2017-10-13 13:27 0 4677 推荐指数：
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