本文首发于微信公众号“花蚂蚁”，想要学习FPGA及Verilog的同学可以关注一下。 1. if_else语句 if语句是用来判定所给定的条件是否满足，根据判定的结果（真或假)决定执行给出的两种操作之一。Verilog HDL语言提供了三种形式的if语句。 (1). if(表达式)语句 ...

条件语句可以分为if_else语句和case语句两张部分。 A)if_else语句 三种表达形式 1） if（表达式） 2）if（表达式） 3）if（表达式1） 语句1； 语句 ...

块语句是指将两条或者两条以上的语句组合在一起，使其在格式上更像一条语句。块语句分为两种： 1）用begin_end语句，通常用来标识顺序执行的语句，用它标识的块称作顺序块； 2）用fork_join语句，通常用来标识并行执行的语句，用它标识的块称作并行块。 A）顺序块 begin ...

在Verilog中存在着4种类型的循环语句，用来控制执行语句的执行次数。 1）forever语句： 连续执行的语句。 2）repeat语句： 连续执行n次的语句。 3）while语句： 执行语句，直至某个条件不满足。 4）for 语句： 三个部分，尽量少用或者不用 ...

二、电路设计（语法） 1、设计不用的语法 a）initial【设计不用，仿真时用】 b）task/function【设计不用、仿真很少用】 c）for/while/repeat/forever【设计不用、仿真很少用】 d）integer【设计不用】 e）模块内部最好不要有X态、Z态 ...

在Verilog HDL语言中，信号有两种赋值方式。 A）非阻塞赋值（Non-Blocking）方式（如：b<=a;） (1)在语句块中，上面语句所赋值的变量不能立即为下面的语句所用； (2)块结束后才能完成这次赋值操作，赋值的职位上次赋值得到的； (3)在编写可综合的时序逻辑模块时 ...

一、常量 　　常量按类型分为数字常量、字符常量和其他。 1.数字常量 　　数字常量分为整数和实数。 　　整数的表示形式：<+/-><数字位宽>'<数字类型> ...

欢迎大家关注我的微信公众账号，支持程序媛写出更多优秀的文章 Verilog中总共有十九种数据类型，我们先介绍四个最基本的数据类型，他们是： reg型、wire型、integer型、parameter型 1 常量 　　1.1 数字integer 　　　　整数：b二进制 d ...