verilog event 用法
在testbench中，可以使用event变量触发事件。 event变量声明为： event var; event触发为： ->var; 捕获触发为： @(var); 实例代码如下： 10个时间单位后reset_trigger事件被触发，捕获后将reset设置 ...
原文：Verilog之event的用法
编写verilog的testbench时，可使用event变量触发事件。 event变量声明为： event var event触发为： gt var 捕获触发为： var 在modelsim中可运行的实例码如下： 个时间单位后reset trigger事件被触发，捕获后将reset设置一个时钟周期再触发reset done trigger。之后再分别设置 个周期的随机信号给enable和rese ...
2013-12-26 20:09 0 6364 推荐指数：
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