FPGA学习笔记06-VHDL语法基础-生成语句(generate)
目录 一、概述 二、形式 三、程序示例 四、仿真说明 一、概述 GENERATE 语句用来产生多个相同的结构和描述规则结构，如阵列、元件例化和进程。 二、形式 1. FOR ...
原文：VHDL基础 学习笔记
最近一直忙着学校里的活动，所以没怎么更新，上周活动忙完了，正好也借着数电实验的机会，重新学习一下VHDL的编程。以下是转自 doc的教程： 本学习以MAXPLUS 为工具软件 第一章 VHDL程序的组成 一个完整的VHDL程序是以下五部分组成的： 库 LIBRARY ：储存预先已经写好的程序和数据的集合 程序包 PACKAGE ：声明在设计中将用到的常数 数据类型 元件及子程序 实体 ENTITY ...
2013-10-24 11:24 0 6511 推荐指数：
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